Verfahren zum Schnellen Tempern von Mehrschicht-Wafern mit einer Kante
EP1559136
Art B1
12. Oktober 2011
Anmelder: Soitec, S.O.I. Tec Silicon Insulator Technologies 🇫🇷
Details
- Veröffentlichungs-Nr.
- EP1559136
- Aktenzeichen
- EP03772490
- Anmeldetag
- 3. November 2003
- Veröffentlichung
- 12. Oktober 2011
- Erteilung
- 12. Oktober 2011
- Rechtsraum
- EP
- IPC
- H01L21/324H01L21/00H01L21/762
Abstract
Für dieses Patent liegt uns kein Abstract vor.
Anmelder
- Firmen
- Soitec
S.O.I. Tec Silicon Insulator Technologies - Land
- 🇫🇷 Frankreich
🇫🇷
Soitec
Französischer Halbleiterhersteller mit Sitz in Bernin, spezialisiert auf Silicon-on-Insulator (SOI) Substrate. Patente decken Halbleitermaterialien und Waferbondtechnik ab.
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