Adaptive Steuerung eines Betriebs im Niederstrommodus für einen Cachespeicher

EP2843561 Art B1 14. Juni 2017

Anmelder: Intel Corporation 🇺🇸

Details

Veröffentlichungs-Nr.
EP2843561
Aktenzeichen
EP14182706
Anmeldetag
28. August 2014
Veröffentlichung
14. Juni 2017
Erteilung
14. Juni 2017
Rechtsraum
EP
IPC
G06F12/00G06F1/32
Offizieller Volltext

Abstract

In an embodiment, a processor includes a plurality of cores each to independently execute instructions, a cache memory including a plurality of portions distributed across a die of the processor, a plurality of sleep circuits each coupled to one of the portions of the cache memory, and at least one sleep control logic coupled to the cache memory portions to dynamically determine a sleep setting independently for each of the sleep circuits and to enable the corresponding sleep circuit to maintain the corresponding cache memory portion at a retention voltage. Other embodiments are described and claimed.

Anmelder

Firma
Intel Corporation
Land
🇺🇸 USA
🇺🇸 Intel

US-amerikanischer Halbleiterhersteller mit Sitz in Kalifornien. Entwickelt und produziert Prozessoren, Chipsätze sowie weitere Halbleiterkomponenten für Computer, Server und eingebettete Systeme.

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