Kontaktarchitektur für Kapazitätsreduktion und Zufriedenstellenden Kontaktwiderstand und Zugehörige Methode

EP3920212 Art B1 1. Oktober 2025

Anmelder: INTEL Corporation 🇺🇸

Details

Veröffentlichungs-Nr.
EP3920212
Aktenzeichen
EP21188335
Anmeldetag
30. Dezember 2016
Veröffentlichung
1. Oktober 2025
Erteilung
1. Oktober 2025
Rechtsraum
EP
IPC
H01L21/768H10D30/01H10D30/60H10D62/13H10D64/01H10D64/62// H01L21/285
Offizieller Volltext

Abstract

Für dieses Patent liegt uns kein Abstract vor.

Anmelder

Firma
INTEL Corporation
Land
🇺🇸 USA
🇺🇸 Intel

US-amerikanischer Halbleiterhersteller mit Sitz in Kalifornien. Entwickelt und produziert Prozessoren, Chipsätze sowie weitere Halbleiterkomponenten für Computer, Server und eingebettete Systeme.

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