Layout method for analog circuit, and data processing system

WO2007105263 Art A1 20. September 2007

Anmelder: Renesas Technology Corp. 🇯🇵

Details

Veröffentlichungs-Nr.: WO2007105263
Aktenzeichen: EP06728871
Anmeldetag: 10. März 2006
Veröffentlichung: 20. September 2007
Rechtsraum: WO
IPC: G06F17/50

Offizieller Volltext

Abstract

Für dieses Patent liegt uns kein Abstract vor.

Anmelder

Firma: Renesas Technology Corp.
Land: 🇯🇵 Japan

🇯🇵 Renesas Technology

Renesas Technology war ein japanischer Halbleiterhersteller und Vorgängerunternehmen der heutigen Renesas Electronics. Das Patentportfolio konzentriert sich auf Halbleiter und elektrische Bauelemente sowie Software, ergänzt um Datenspeicher- und Schaltungstechnik. Anmeldungen stammen aus den Jahren 2000 bis 2009.

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Fachgebiete

Software & Datenverarbeitung

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